.


:




:

































 

 

 

 


4




8. XOR2. : I0, I1,-, -. =I0^I1. OR2 8.

8- OR2

I0 I1
     
     
     
     

 

9. XOR4. : I0, I1,I2, I3 -, -. =I0^I1^I2^I3. XOR4 .

 

: , , , .

3

: .

: XC9572XL, XilinxISEDesignSuite14.4

:

1. BTN3 LD8-LD1 SW8-SW1 .

32

3.25. - 1

2. BTN5 LD8-LD5 SW8-SW5 . LD4-LD1 SW4-SW1.

3.26 (. . 3.26)

3.26 - 2

3. BTN1 LD8-LD5 SW8-SW5, LD4-LD1 SW4-SW1.

3.27 3

3.27- 3

4. BTN4 BTN2 .

3.28 4

3.28 - 4

: : , , , .

 

4

: . : FD, LD, FDCP, FTC, CB4CE, CD4CE, COMP4, D2_4E, D3_8E, D4_E16, M2_1, M4_1E.

:

1. FD - D . :D - ; D. - ; Q . FD 1

1- FD

D Q
/     0 ()
/     1 ()
 
  0

 

2. LD D (D- ). :D - ; G - ; Q . , . .

 

LD 2.

2- LD

G D Q
      D(0)
      D(1)
/     (0)
/     (1)
 

3. FDCP - D . : D- D; C- ; CLR- ; PRE- ,Q- . FDCP 3.

3- FDCP

CLR PRE D Q
    /     0 ()
    /     1()
     
     
     
   

 

4. FTC - T . : - ; - ; CLR- ; Q- .

FTC 14.

4- FTC

CLR Q
    /
   
   
   
   

 

5. 4 - .

5- 4

CLR QI TC CEO
       
/         (Q[3;0]#1111)
/         Q[3;0]=1111)
     

 

: - ; - ; CLR- ; Q0-Q3- (0-3 ); - ( ); - (=&).

4 5.

6. D4 - - . : - , - , CLR- , Q0-Q3- (0-3 ), - ( ), - (=&). D4 6.

6- D4

C CLR QI TC CEO
       
/         (Q[3;0]=1111)
/         (Q[3;0]=1111)
     

7.4 - . : 0-3- ( 0-3), 0-3- ( 0-3), EQ- =. 7.

7-

0-3, 0-3 EQ
IA0=IB0 IA1=IB1 IA2=IB2 IA3=IB3  
IA0#IB0 IA1#IB1 IA2#IB2 IA3#IB3  

 

8. D2_4E- 2 4 , , 0 1, , D0-D3, . D2_4E . 8.

8- D2_4E

0 1 D0 D1 D2 D3
             
             
               
             
         

9. D3_8E - 3 8 , , 0-2, .

10. D4_16E - 4 16 , , 0-3, , D0-D15, . : - , 0-3- ( 0-3), D0-D15-(0-15 ).

11. 2_1 - (2 1) . D0, D1- ,S0- , O-.

12. 4_1 - (4 1) . : D0-D3- ,S0,S1- ,O-.

 

5

: .

: , 50 5*106 , 1. D-. , .

1. 2 . 25000000 , 2 . - 1.

3. , 25 D- , ..

4. , 25000000- . -.

3.30 .


3.30 - .

6





:


: 2017-04-14; !; : 418 |


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:

80% - .
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